DS2430AP+ EEPROM IC TSOC-6 電気的に消去可能なプログラム可能な読み取り専用メモリ

製品の説明

DS2430AP+ 電気的に消去可能なプログラマブル読み取り専用メモリ M71PL128BOBGW9UOA CMT04N60 メモリ データ ストレージ

説明

DS2430A 256 ビット 1-Wire® EEPROM は、関連付けられている製品に関する関連情報を識別して保存します。このロットまたは製品固有の情報には、マイクロコントローラの単一ポート ピンなど、最小限のインターフェイスでアクセスできます。DS2430A は、固有の 48 ビットのシリアル番号、8 ビットの CRC、および 8 ビットのファミリー コード (14h) を含む工場でレーザー加工された登録番号と、256 ビットのユーザー プログラム可能な EEPROM および 64 ビットの EEPROM で構成されています。 -時間プログラマブル アプリケーション レジスタ。DS2430A の読み書きの電力は、すべて 1-Wire 通信ラインから得られます。データは 1-Wire プロトコルを介してシリアルに転送され、1 つのデータ リードとグラウンド リターンしか必要としません。工場で各 DS2430A にレーザー加工された 48 ビットのシリアル番号は、絶対的なトレーサビリティを可能にする保証された一意の ID を提供します。TO-92 および TSOC パッケージはコンパクトなエンクロージャを提供し、標準のアセンブリ機器でデバイスを簡単に処理して、プリント回路基板または配線に取り付けることができます。典型的なアプリケーションには、キャリブレーション定数、ボード識別、および製品リビジョン ステータスの保存が含まれます。

概要

図 1 のブロック図は、DS2430A の主要な制御セクションとメモリ セクションの関係を示しています。DS2430A には、4 つの主要なデータ コンポーネントがあります。1) 64 ビットのレーザー ROM、2) スクラッチパッド付きの 256 ビット EEPROM データ メモリ、3) スクラッチパッド付きの 64 ビットのワンタイム プログラマブル アプリケーション レジスタ、および 4) 8 ビットのステータス メモリ。1-Wire プロトコルの階層構造を図 2 に示します。バス マスタは最初に、4 つの ROM 機能コマンドの 1 つを提供する必要があります。1) ROM の読み取り、2) ROM の一致、3) ROM の検索、4) ROM のスキップ。これらの ROM 機能コマンドに必要なプロトコルを図 8 に示します。ROM 機能コマンドが正常に実行されると、メモリ機能にアクセスできるようになり、マスターは 4 つのメモリ機能コマンドのいずれかを提供できます。これらのメモリ機能コマンドのプロトコルを図 6 に示します。すべてのデータは最下位ビットから読み出され、書き込まれます。

64 ビット レーザー ROM

各 DS2430A には、64 ビット長の固有の ROM コードが含まれています。最初の 8 ビットは 1-Wire ファミリ コード (14h) です。次の 48 ビットは固有のシリアル番号です。最後の 8 ビットは、最初の 56 ビットの CRC です。(図 3)。1-Wire CRC は、図 4 に示すように、シフト レジスタと XOR ゲートで構成される多項式ジェネレータを使用して生成されます。多項式は X8 + X5 + X4 + 1 です。1-Wire CRC に関する追加情報は、アプリケーション ノート 27 で入手できます。 . シフト レジスタのビットは 0 に初期化されます. 次に、ファミリー コードの最下位ビットから始めて、一度に 1 ビットがシフトされます. ファミリー コードの 8 番目のビットが入力された後、シリアル番号が入力されます.シリアル番号の 48 番目のビットが入力されると、シフト レジスタに CRC 値が格納されます。CRC の 8 ビットをシフトインすると、シフト レジスタはすべて 0 に戻ります。

関連ストックモデル

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